Diseño e implementación de sistemas de procesado de señal en FPGAs (3ª edición)

Información do curso

Diseño e implementación de sistemas de procesado de señal en FPGAs (3ª edición)


Tipo Curso de Formación
Código FT110802
Nome Diseño e implementación de sistemas de procesado de señal en FPGAs (3ª edición)
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Modalidade Presencial
Descrición Diseño de sistemas de procesado de señal en FPGAs utilizando herramientas de alto nivel: simulación, verificación e implementación hardware.
Información de contacto:  
 · Teléfono 986 812163
 · Fax
 · Enderezo electrónico
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Descrición

El presente curso está dirigido a estudiantes universitarios y profesionales interesados en profundizar sus conocimientos acerca de la tecnología de circuitos configurables (PLDs y FPGAs) y su aplicación al área del procesado de señal. Para ello se analizarán y utilizarán herramientas y plataformas avanzadas de diseño a través de las cuales el alumno podrá adquirir una visión actualizada de los recursos de diseño disponibles así como los conocimientos y habilidades suficientes para el manejo de dichas herramientas.

Entidades organizadoras

Departamento de Tecnología Electrónica

Páxina web do curso

http://webs.uvigo.es/mvaldes/

Información sobre o calendario (datas)

Período de preinscrición 12/05/2008 00:00 - 26/05/2008 23:59
Período de matrícula 02/06/2008 00:00 - 11/07/2008 23:59
Período de docencia 23/06/2008 - 27/06/2008

Prazas e créditos

Número mínimo de participantes 24
Número máximo de participantes 50
Créditos teóricos .6
Créditos prácticos 2.4

Destinatarios/as

El presente curso está dirigido a estudiantes universitarios y profesionales interesados en profundizar sus conocimientos acerca de la tecnología de circuitos configurables (PLDs y FPGAs) y su aplicación al área del procesado de señal. Para ello se analizarán y utilizarán herramientas y plataformas avanzadas de diseño a través de las cuales el alumno podrá adquirir una visión actualizada de los recursos de diseño disponibles así como los conocimientos y habilidades suficientes para el manejo de dichas herramientas.

Condicións de acceso

1.Titulados/as universitarios o estudiantes de primer y segundo ciclo preferentemente de las titulaciones de Ing. Industrial/Ing. Técnica Industrial e Ing. de Telecomunicación/Ing. Técnica de Telecomunicación.

2.Profesionales directamente vinculados con la Electrónica, siempre y cuando reunan los requisitos legales para cursar estudios universitarios.

3.De forma excepcional y siempre que no superen el 50% del total de los alumnos del curso, podrán ser admitidos profesionales relacionados con la Electrónica que non reúnan los requisitos legales de acceso a la universidad.

Criterios de selección

Orden de preinscripción y perfil del alumno.

Calendario

Se impartirán dos convocatorias del curso (una en junio y la otra en julio)

1ª convocatoria: Del 23/06/08 al 27/06/08
Periodo de preinscripción: 12/05/2008 al 26/05/08
Periodo de matrícula: 02/06/08 al 13/06/08

2ª convocatoria: Del 07/07/08 al 12/07/08
Periodo de preinscripción: 12/05/2008 al 26/05/08
Periodo de matrícula: 16/06/08 al 27/06/08

LUGAR: Laboratorio de Electrónica Digital del Departamento de Tecnología Electrónica (ampliación ETSI de Telecomunicación)

HORARIO: De 09:30 a 14:00 y de 15:00 a 17:00 horas

Programa

MÓDULOS TEÓRICOS:
Herramientas de diseño avanzadas para FPGAs
Arquitecturas avanzadas de FPGAs
Procesado de señales en FPGAs
MÓDULOS PRÁCTICOS:
Diseño y simulación de módulos de procesado de señal
Diseño y simulación de sistemas complejos de procesado de señal
Diseño de una unidad MAC (multiplicación y acumulación)
Diseño de filtros FIR- Aplicación a un sistema de procesado de audio
Diseño de sistemas multi-rate
Síntesis e implementación de bloques diseñados en los módulos P03,P04 y P05

Sistema de avaliación

Clases presenciales.
Seguimiento continuo mediante la realización de actividades y ejercicios por parte del alumno.

Calquera dúbida acerca dos detalles dun curso debe dirixila á dirección de dito curso. Por favor, consulte o apartado Información de contacto do curso.

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